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針對閃存(flash)因制造工藝的不斷提高而導(dǎo)致其內(nèi)部數(shù)據(jù)區(qū)隨機(jī)錯誤不斷增加的現(xiàn)象,設(shè)計并實現(xiàn)一種高速BCH編碼譯碼器,通過BCH編碼技術(shù)對flash中的隨機(jī)錯誤進(jìn)行糾錯,以達(dá)到錯誤檢測與糾錯的目的。實驗結(jié)果顯示優(yōu)化設(shè)計的BCH(4 224,4 096)編碼譯碼器可以工作在25 MHz的工作頻率下,其單頁數(shù)據(jù)(512 Byte)的糾錯能力從普遍的3 bit提高到15 bit,從而提高了flash數(shù)據(jù)存儲與讀取的可靠性。
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在介紹LDPC（Low Density Parity Code）低密度校驗碼的基本迭代譯碼原理的基礎(chǔ)上,針對FPGA技術(shù),專門設(shè)計了譯碼器中通用的變量節(jié)點以及校驗節(jié)點處理單元,其中分別包括全并行與全串行的實現(xiàn)方式。編譯結(jié)果表明,這些模塊可以實現(xiàn)高速的處理速度,以及占用合理的硬件資源。
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