更新時間：2025.05.31
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設(shè)計具有帶寬約束的網(wǎng)絡(luò)控制器,采用帶時倚強(qiáng)度的泊松過程形成隨機(jī)通信邏輯調(diào)度策略,實現(xiàn)系統(tǒng)狀態(tài)的有限次更新,根據(jù)其馬爾科夫跳變本質(zhì),基于更新時刻特性,協(xié)同設(shè)計控制器。仿真結(jié)果表明,引入隨機(jī)通信邏輯能減少狀態(tài)更新的次數(shù),降低網(wǎng)絡(luò)帶寬對控制性能的影響,提高系統(tǒng)的動態(tài)性能。
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本文提出了一種基于SOPC的LED網(wǎng)絡(luò)控制器的設(shè)計方法。采用FPGA+SRAM+PHY/MAC的結(jié)構(gòu),構(gòu)建了網(wǎng)絡(luò)控制器硬件平臺。采用軟硬件協(xié)調(diào)設(shè)計理念,通過添加NiosII自定義外設(shè)IP軟核、利用FPGA和外部SRAM構(gòu)建大容量FIFO以及優(yōu)化網(wǎng)卡驅(qū)動程序,實現(xiàn)TOE和RDMA功能,從而提高網(wǎng)絡(luò)控制器的帶寬、保證LED屏畫面流暢。系統(tǒng)測試表明,控制器性能穩(wěn)定,NiosII工作在50MHz時,網(wǎng)絡(luò)控制器接收UDP數(shù)據(jù)的帶寬為60Mbps。
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