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數(shù)據(jù)存儲(chǔ)論文 題目名稱： 磁盤陣列 學(xué)院名稱： 計(jì)算機(jī)科學(xué)與信息工程學(xué)院 專業(yè)班級(jí)： 學(xué)生姓名： 2011 年 1 月 目 錄 一、成員分工 ................................................................................................................................. 1 二、摘要 ......................................................................................................................................... 2 三、正文 .............................................
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本文給出了一種采用Altera公司的Cyclone系列EP1C12Q240C8的FPGA芯片設(shè)計(jì)磁盤陣列校驗(yàn)卡的硬件電路的方法。該設(shè)計(jì)采用了并行的思想,令數(shù)據(jù)在PCI總線上的傳輸過(guò)程和校驗(yàn)計(jì)算過(guò)程在時(shí)間上重疊,使得整個(gè)校驗(yàn)過(guò)程耗費(fèi)的時(shí)間等同于數(shù)據(jù)在總線上傳輸?shù)臅r(shí)間,從而最大限度地提高了校驗(yàn)性能。設(shè)計(jì)經(jīng)軟件仿真和硬件實(shí)現(xiàn),結(jié)果表明電路性能可靠。
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磁盤陣列卡
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