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基于AX88796C的低功耗以太網(wǎng)接口模塊設計

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為了實現(xiàn)低功耗以太網(wǎng)接口電路的設計,同時滿足兼容多種微處理器的目的,采用低功耗并支持SPI及NonPCI總線的以太網(wǎng)控制器AX88796C作為核心芯片,提出了一種低功耗以太網(wǎng)接口模塊的設計方案,同時給出了設計中的一些注意事項。

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一種萬兆以太網(wǎng)在線數(shù)據(jù)收發(fā)器的設計

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一種用于萬兆以太網(wǎng)在線安全處理器中的高速數(shù)據(jù)幀收發(fā)器的結構設計.采用基于中斷的共享式緩存加分布式緩存的二級緩沖收發(fā)機制,實現(xiàn)對萬兆以太網(wǎng)數(shù)據(jù)幀的高效在線收發(fā).通過改進一種調度算法的硬件實現(xiàn),完成對可變長度數(shù)據(jù)包的高效調度.利用系統(tǒng)級建模語言systemC對設計進行建模,通過仿真優(yōu)化分布式緩存FIFO的數(shù)量實現(xiàn)丟包率為0.將設計應用到一款萬兆在線網(wǎng)絡安全處理器中,實驗結果表明,時鐘頻率250 MHz下的數(shù)據(jù)吞吐率達到10.06Gb/s,丟包率為0,驗證了設計性能.通過配置模塊中分布式緩存的數(shù)量,設計可以應用于下一代40/100Gb/s網(wǎng)絡安全處理器中滿足更高速信息安全的需求.

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